Ing. invest. y tecnol.- PDF Download - Art. IDS1405-77432008000300006

Ingeniería, investigación y tecnología
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CASTILLO-SORIA, F.R.; PACHECO-BAUTISTA, D. e SANCHEZ-MERAZ, M.. Frame, bit and chip error rate evaluation for a DSSS communication system. Ing. invest. y tecnol. [online]. 2008, vol.9, n.3, pp.271-277. ISSN 2594-0732.

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